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電源干擾的抑制
一般通過設(shè)置屏蔽電纜和PLC局部屏蔽及高壓泄放元件進(jìn)行保護(hù)。選用隔離性能較好的設(shè)備、選用優(yōu)良的電源、動(dòng)力線和信號(hào)線走線要更加合理等等，對(duì)電源變壓器、中央處理器、編程器等主要部件，采用導(dǎo)電、導(dǎo)磁性良好的材料進(jìn)行屏蔽處理，以防止外界干擾信號(hào)的影響。電源調(diào)整與保護(hù):電源波動(dòng)造成電壓畸變或毛刺，將對(duì)PLC及I/O模塊產(chǎn)生不良影響。對(duì)微處理器核心部件所需要的＋5V電源采用多級(jí)濾波處理，并用集成電壓調(diào)整器進(jìn)行調(diào)整，以適應(yīng)交流電網(wǎng)的波動(dòng)和過電壓、欠電壓的影響。盡量時(shí)電源線平行走線，時(shí)電源線對(duì)地呈低阻抗，以減少電源噪聲干擾。其屏蔽層接地方式不同，對(duì)干擾抑制效果不一樣，一般次級(jí)線圈不能接地。輸入、輸出線應(yīng)用雙絞線且屏蔽層應(yīng)可靠接地，以抑制共摸干擾。此外可以安裝一臺(tái)帶屏蔽層的變比為1：1的隔離變壓器，以減少設(shè)備與地之間的干擾，還可以在電源輸入端串接LC濾波電路等。
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